PCI: Drop CONFIG_TSI108_PCI
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d928664f41 ("powerpc: 74xx_7xx: remove 74xx_7xx cpu support")
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commit
55acf49eab
@ -29,7 +29,6 @@ obj-$(CONFIG_SH4_PCI) += pci_sh4.o
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obj-$(CONFIG_SH7751_PCI) +=pci_sh7751.o
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obj-$(CONFIG_SH7751_PCI) +=pci_sh7751.o
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obj-$(CONFIG_SH7780_PCI) +=pci_sh7780.o
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obj-$(CONFIG_SH7780_PCI) +=pci_sh7780.o
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||||||
obj-$(CONFIG_PCI_TEGRA) += pci_tegra.o
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obj-$(CONFIG_PCI_TEGRA) += pci_tegra.o
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obj-$(CONFIG_TSI108_PCI) += tsi108_pci.o
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obj-$(CONFIG_PCIE_DW_MVEBU) += pcie_dw_mvebu.o
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obj-$(CONFIG_PCIE_DW_MVEBU) += pcie_dw_mvebu.o
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obj-$(CONFIG_PCIE_LAYERSCAPE) += pcie_layerscape.o
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obj-$(CONFIG_PCIE_LAYERSCAPE) += pcie_layerscape.o
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||||||
obj-$(CONFIG_PCIE_LAYERSCAPE) += pcie_layerscape_fixup.o
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obj-$(CONFIG_PCIE_LAYERSCAPE) += pcie_layerscape_fixup.o
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@ -1,167 +0,0 @@
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/*
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||||||
* (C) Copyright 2004 Tundra Semiconductor Corp.
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||||||
* Alex Bounine <alexandreb@tundra.com>
|
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||||||
*
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||||||
* SPDX-License-Identifier: GPL-2.0+
|
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||||||
*/
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||||||
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||||||
/*
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||||||
* PCI initialisation for the Tsi108 EMU board.
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*/
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#include <config.h>
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#include <common.h>
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#include <pci.h>
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#include <asm/io.h>
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#include <tsi108.h>
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#if defined(CONFIG_OF_LIBFDT)
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#include <libfdt.h>
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#include <fdt_support.h>
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#endif
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struct pci_controller local_hose;
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void tsi108_clear_pci_error (void)
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{
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u32 err_stat, err_addr, pci_stat;
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/*
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* Quietly clear errors signalled as result of PCI/X configuration read
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* requests.
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*/
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/* Read PB Error Log Registers */
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||||||
err_stat = *(volatile u32 *)(CONFIG_SYS_TSI108_CSR_BASE +
|
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TSI108_PB_REG_OFFSET + PB_ERRCS);
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||||||
err_addr = *(volatile u32 *)(CONFIG_SYS_TSI108_CSR_BASE +
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TSI108_PB_REG_OFFSET + PB_AERR);
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if (err_stat & PB_ERRCS_ES) {
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/* Clear PCI/X bus errors if applicable */
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if ((err_addr & 0xFF000000) == CONFIG_SYS_PCI_CFG_BASE) {
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/* Clear error flag */
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||||||
*(u32 *) (CONFIG_SYS_TSI108_CSR_BASE +
|
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||||||
TSI108_PB_REG_OFFSET + PB_ERRCS) =
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PB_ERRCS_ES;
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||||||
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||||||
/* Clear read error reported in PB_ISR */
|
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||||||
*(u32 *) (CONFIG_SYS_TSI108_CSR_BASE +
|
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||||||
TSI108_PB_REG_OFFSET + PB_ISR) =
|
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||||||
PB_ISR_PBS_RD_ERR;
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||||||
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||||||
/* Clear errors reported by PCI CSR (Normally Master Abort) */
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||||||
pci_stat = *(volatile u32 *)(CONFIG_SYS_TSI108_CSR_BASE +
|
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||||||
TSI108_PCI_REG_OFFSET +
|
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||||||
PCI_CSR);
|
|
||||||
*(volatile u32 *)(CONFIG_SYS_TSI108_CSR_BASE +
|
|
||||||
TSI108_PCI_REG_OFFSET + PCI_CSR) =
|
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||||||
pci_stat;
|
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||||||
|
|
||||||
*(volatile u32 *)(CONFIG_SYS_TSI108_CSR_BASE +
|
|
||||||
TSI108_PCI_REG_OFFSET +
|
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||||||
PCI_IRP_STAT) = PCI_IRP_STAT_P_CSR;
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||||||
}
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||||||
}
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||||||
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||||||
return;
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||||||
}
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unsigned int __get_pci_config_dword (u32 addr)
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||||||
{
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unsigned int retval;
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||||||
__asm__ __volatile__ (" lwbrx %0,0,%1\n"
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"1: eieio\n"
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||||||
"2:\n"
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||||||
".section .fixup,\"ax\"\n"
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||||||
"3: li %0,-1\n"
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||||||
" b 2b\n"
|
|
||||||
".section __ex_table,\"a\"\n"
|
|
||||||
" .align 2\n"
|
|
||||||
" .long 1b,3b\n"
|
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||||||
".section .text.__get_pci_config_dword"
|
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||||||
: "=r"(retval) : "r"(addr));
|
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||||||
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||||||
return (retval);
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||||||
}
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||||||
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||||||
static int tsi108_read_config_dword (struct pci_controller *hose,
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||||||
pci_dev_t dev, int offset, u32 * value)
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||||||
{
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||||||
dev &= (CONFIG_SYS_PCI_CFG_SIZE - 1);
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||||||
dev |= (CONFIG_SYS_PCI_CFG_BASE | (offset & 0xfc));
|
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||||||
*value = __get_pci_config_dword(dev);
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||||||
if (0xFFFFFFFF == *value)
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||||||
tsi108_clear_pci_error ();
|
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||||||
return 0;
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||||||
}
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||||||
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||||||
static int tsi108_write_config_dword (struct pci_controller *hose,
|
|
||||||
pci_dev_t dev, int offset, u32 value)
|
|
||||||
{
|
|
||||||
dev &= (CONFIG_SYS_PCI_CFG_SIZE - 1);
|
|
||||||
dev |= (CONFIG_SYS_PCI_CFG_BASE | (offset & 0xfc));
|
|
||||||
|
|
||||||
out_le32 ((volatile unsigned *)dev, value);
|
|
||||||
|
|
||||||
return 0;
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||||||
}
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void pci_init_board (void)
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{
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struct pci_controller *hose = (struct pci_controller *)&local_hose;
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hose->first_busno = 0;
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||||||
hose->last_busno = 0xff;
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||||||
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||||||
pci_set_region (hose->regions + 0,
|
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||||||
CONFIG_SYS_PCI_MEMORY_BUS,
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||||||
CONFIG_SYS_PCI_MEMORY_PHYS,
|
|
||||||
CONFIG_SYS_PCI_MEMORY_SIZE, PCI_REGION_MEM | PCI_REGION_SYS_MEMORY);
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||||||
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||||||
/* PCI memory space */
|
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||||||
pci_set_region (hose->regions + 1,
|
|
||||||
CONFIG_SYS_PCI_MEM_BUS,
|
|
||||||
CONFIG_SYS_PCI_MEM_PHYS, CONFIG_SYS_PCI_MEM_SIZE, PCI_REGION_MEM);
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||||||
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|
||||||
/* PCI I/O space */
|
|
||||||
pci_set_region (hose->regions + 2,
|
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||||||
CONFIG_SYS_PCI_IO_BUS,
|
|
||||||
CONFIG_SYS_PCI_IO_PHYS, CONFIG_SYS_PCI_IO_SIZE, PCI_REGION_IO);
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||||||
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||||||
hose->region_count = 3;
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||||||
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||||||
pci_set_ops (hose,
|
|
||||||
pci_hose_read_config_byte_via_dword,
|
|
||||||
pci_hose_read_config_word_via_dword,
|
|
||||||
tsi108_read_config_dword,
|
|
||||||
pci_hose_write_config_byte_via_dword,
|
|
||||||
pci_hose_write_config_word_via_dword,
|
|
||||||
tsi108_write_config_dword);
|
|
||||||
|
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||||||
pci_register_hose (hose);
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||||||
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||||||
hose->last_busno = pci_hose_scan (hose);
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debug ("Done PCI initialization\n");
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||||||
return;
|
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||||||
}
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#if defined(CONFIG_OF_LIBFDT)
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void ft_pci_setup(void *blob, bd_t *bd)
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{
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int nodeoffset;
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||||||
int tmp[2];
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||||||
const char *path;
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||||||
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||||||
nodeoffset = fdt_path_offset(blob, "/aliases");
|
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||||||
if (nodeoffset >= 0) {
|
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||||||
path = fdt_getprop(blob, nodeoffset, "pci", NULL);
|
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||||||
if (path) {
|
|
||||||
tmp[0] = cpu_to_be32(local_hose.first_busno);
|
|
||||||
tmp[1] = cpu_to_be32(local_hose.last_busno);
|
|
||||||
do_fixup_by_path(blob, path, "bus-range",
|
|
||||||
&tmp, sizeof(tmp), 1);
|
|
||||||
}
|
|
||||||
}
|
|
||||||
}
|
|
||||||
#endif /* CONFIG_OF_LIBFDT */
|
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||||||
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